华体会西安电子科技大学正在 EDA 硬件仿真编译范畴博得系列要紧学术功劳华为、思

发布日期:2024-07-25 12:09浏览次数:

  干系商量职业获取邦度自然科学基金项目、华为身手有限公司、上海思尔芯身手股份有限公司等校企协作项目资助,干系功效使用于我邦硬件仿真器研发。

  硬件仿真器(EMU)是仿真验证中的根蒂性 EDA 用具,硬件编译身手则是硬件仿真器研发的合节。课题组面向 FPGA、专用 CPU 等两种身手门途的 EMU 中电途划分,求解经典的超图划分 N-P 困难目范畴,更始提出了面向众 FPGA 编制、管理器更动驱动的电途划分框架,完成了数十亿界限的超图划分高效优化求解,赢得了干系功效。

  该设施通过将大界限电途凭据拓扑序平衡度举办高效地聚类,精巧地诈欺电途节点的衔尾度和拓扑平衡度获取初始结果,进而正在每一层开展电途前进行有用地改正,完成了编译流程中的高质地划分。

  这一更始性设施不单增添了更动驱动的电途划分倾向的商量空缺,也为高职能的硬件仿真供应了首要商量思绪。

  该职业的第一作家为集成电途学部 2022 级博士商量生毕舜阳,西安电子科技大学为第一完结单元,逛海龙教学为通信作家。

华体会西安电子科技大学正在 EDA 硬件仿真编译范畴博得系列要紧学术功劳华为、思(图1)

  为治理因众 FPGA 编制拓扑、TDM 等成分导致划分后电途时序职能低重的题目,商量团队正在MaPart: An Efficient Multi-FPGA System-Aware Hypergraph Partitioning Framework论文中更始性地提出了一个零违例的高效划分器 TopoPart+,该划分器被集成正在一个二分查找的算法框架中,完成最小 hop 的初始划分计划,进而正在拓扑感知和堵塞途途驱动的改正下取得细化的高质地划分结果。

  为把握布线阶段的 hop 的延时,团队还精巧地纠合分层图思思完成了布线算法。这一系列打破性的职业极大地擢升了电途仿真每每序职能华体会,闪现了正在时序驱动的划分的首要转机。

华体会西安电子科技大学正在 EDA 硬件仿真编译范畴博得系列要紧学术功劳华为、思(图2)

  论文供应了一种排除违例的候选 FPGA 传扬算法,纠合高效的划分算法,该计划最终可完成众 FPGA 编制划分后零违例的宗旨,潜正在擢升了编译的时序职能,为完成高职能硬件仿真和原型验证方面供应了广博使用前景。

  该职业的第一作家为集成电途学部 2020 级博士商量生李本正,逛海龙教学为通信作家,西安电子科技大学为第一完结单元。

华体会西安电子科技大学正在 EDA 硬件仿真编译范畴博得系列要紧学术功劳华为、思(图3)

  邦际揣度机辅助策画集会(ICCAD)和欧洲策画、自愿化与测试集会 (DATE) 是 EDA 范畴程度最高的邦际集会之一,是中邦揣度机学会(CCF)推选的揣度机系统机合与高职能揣度倾向顶级邦际学术集会,集会每年作品投稿量近千篇,每年的领受率为 20%-25%。

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